QCM Architecture des ordinateurs – Partie 15
QCM en architecture des ordinateurs avec la correction pour la préparation des concours, des tests, aux examens et aux certifications. Ainsi vous trouverez des questions sur les différents types de registres dans l’ordinateur, mémoire vive (RAM), mémoire principale, instructions de mémoire, unité arithmétique et logique et beaucoup plus. Cette méthode d’apprentissage systématique préparera facilement toute personne pour réussir son concours.
1. Au cours de l’exécution d’un programme, quel registre est initialisé en premier ?
A MDR
B IR
C PC
D MAR
2. Pendant l’exécution des instructions, une copie des instructions est placée dans le ______.
A le registre
B RAM
C Le tas du système
D Cache
3. Deux processeurs A et B ont des fréquences d’horloge de 700 Mhz et 900 Mhz respectivement. Supposons que A puisse exécuter une instruction en 3 phases et que B puisse l’exécuter en 5 phases. Pour l’exécution de la même instruction, quel processeur est le plus rapide ?
A Processeur A
B Processeur B
C Les deux prennent le même temps
D Information insuffisante
Fréquence d’horloge du processeur A = 700 MHz
Fréquence d’horloge du processeur B = 900 MHz
Phases d’exécution des instructions du processeur A = 3
Phases d’exécution des instructions du processeur B = 5
Pour déterminer quel processeur est le plus rapide, nous devons calculer le temps nécessaire à chaque processeur pour exécuter la même instruction.
Temps pris par le processeur A:
Un cycle d’horloge du processeur A dure 1/700000000 secondes = 1,43 x 10^-9 secondes
Pour exécuter une instruction, le processeur A a besoin de 3 cycles d’horloge = 1,43 x 10^-9 x 3 = 4,29 x 10^-9 secondes.
Temps pris par le processeur B:
Un cycle d’horloge du processeur B dure 1/900000000 secondes = 1,11 x 10^-9 secondes
Pour exécuter une instruction, le processeur B a besoin de 5 cycles d’horloge = 1,11 x 10^-9 x 5 = 5,56 x 10^-9 secondes.
Par conséquent, le processeur A est plus rapide puisqu’il lui faut 4,29 x 10^-9 secondes pour exécuter la même instruction alors que le processeur B a besoin de 5,56 x 10^-9 secondes.
La bonne réponse est donc l’option A.
4. Un processeur qui effectue l’extraction ou le décodage d’une instruction différente pendant l’exécution d’une autre instruction est appelé ______.
A Super-scaling
B Pipe-lining
C Calcul parallèle
D Aucune de ces réponses
5. La fréquence d’horloge du processeur peut être améliorée _________
A en améliorant la technologie des circuits logiques
B en réduisant le nombre de traitements effectués en une seule phase
C en utilisant la méthode d’overclocking
D Toutes ces réponses
La fréquence d’horloge d’un processeur est le nombre de cycles qu’il effectue par seconde. La fréquence d’horloge est mesurée en gigahertz (GHz). Une fréquence d’horloge plus élevée indique une unité centrale plus rapide. Par exemple, une fréquence d’horloge de 2,1 GHz correspond à 2,1 milliards de cycles par seconde et une unité centrale de 3,6 GHz peut effectuer 3,6 milliards de cycles par seconde.
6. La principale raison d’utiliser une structure à bus unique est la suivante: ________.
A Transferts de données rapides
B Connectivité et vitesse rentables
C Connectivité rentable et facilité de connexion des périphériques
D Aucun de ces avantages
7. ______ est utilisé pour surmonter les différences de vitesse de transfert de données entre différents appareils.
A Circuits d’amélioration de la vitesse
B Circuits de pont
C Bus multiples
D Les registres tampon (buffers)
8. Quel(s) registre(s) du processeur est/sont connecté(s) au bus de mémoire ?
A PC
B MAR
C IR
D PC et MAR
9. ISP signifie _________.
A Instruction Set Processor
B Information Standard Processing
C Interchange Standard Protocol
D Interrupt Service Procedure
L’ISP est le seul moyen pour un utilisateur d’interagir avec le matériel. Elle peut être considérée comme le manuel du programmeur, car c’est la partie de la machine qui est visible par le programmeur en langage d’assemblage, le compilateur et le programmeur d’applications.
10. Les composants internes du processeur sont connectés par _______
A le circuit de connectivité interne du processeur
B le bus du processeur
C le bus de mémoire
D Rambus
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